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预览 Verilog设计练习进阶(5)-------用always块实现较复杂的组合逻辑电路 attachment eric2013 2013-1-30 24289 eric2013 2013-1-30 13:05
预览 Verilog设计练习进阶(3)-------利用条件语句实现较复杂的时序逻辑电路 attachment eric2013 2013-1-30 14032 eric2013 2013-1-30 09:42
预览 Verilog设计练习进阶(2)-------简单的时序逻辑设计 attachment eric2013 2013-1-29 14045 eric2013 2013-1-29 20:52
预览 Verilog设计练习进阶(1)-------简单的组合逻辑设计 attachment eric2013 2013-1-29 13945 eric2013 2013-1-29 14:55
预览 时序逻辑电路(5)----------分频器 eric2013 2013-1-28 24309 eric2013 2013-1-28 21:28
预览 时序逻辑电路(5)----------分频器 eric2013 2013-1-28 02872 eric2013 2013-1-28 21:17
预览 时序逻辑电路(4)----------移位寄存器 eric2013 2013-1-27 03292 eric2013 2013-1-27 16:29
预览 时序逻辑电路(3)----------计数器 eric2013 2013-1-27 13763 eric2013 2013-1-27 16:02
预览 时序逻辑电路(2)----------触发器(D, JK, T, SR) attachment eric2013 2013-1-27 45566 eric2013 2013-1-27 14:39
预览 时序逻辑电路(1)----------锁存器 attachment eric2013 2013-1-27 24501 eric2013 2013-1-27 13:01
预览 组合逻辑电路(5)----- 算数运算(乘法器) eric2013 2013-1-26 34516 eric2013 2013-1-26 14:53
预览 组合逻辑电路(4)----- 算数运算(加法器 ALU 流水线) attachment eric2013 2013-1-25 64296 eric2013 2013-1-26 11:45
预览 组合逻辑电路(3)-----数据选择器 attachment eric2013 2013-1-25 24580 eric2013 2013-1-25 16:07
预览 组合逻辑电路(2)-----译码器/数据分配器 attachment eric2013 2013-1-25 03267 eric2013 2013-1-25 15:21
预览 Verilog经典实例分析(感觉这是学习verilog最快捷的方法了) attach_img eric2013 2013-1-14 15267 eric2013 2013-1-14 22:12
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